uvm中的monitor
uvm中的monitor的作用主要是捕捉interface上面的信号， 转换成transaction， 然后发送给其他的component。因此需要下面2个要素：
要观测的virtual interface
申明tlm_analysis_port， 然后广播要传输的数据。
monitor的作用m
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uvm_sequence
squence由data item组成， 不同的组合可以产生不同的transaction， 所以便可以产生不同的激励。如下图所示：
下面是使用sequence的步骤：
创建一个自定义的sequence， 派生自[uvm_sequence]。 用factory机制注册， 并且创建new函数：
1
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uvm中的sequencer
squencer 的作用是产生transaction然后发给driver。建议uvm环境中的sequencer从[uvm_squencer]这个类派生出来，因为其中包含了和driver进行通信的一些功能模块
使用方法
申明uvm_squencer时， 参数中的RES和REQ默认情况下是一致的，
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uvm driver介绍
本篇主要介绍uvm环境中的driver。
driver的主要作用是从squencer获取transaction， 然后驱动DUT的interface。如下图所示：
Driver的编写
从uvm_driver派生出自定义的class， 比如说是my_driver, 然后用factory机制注册，
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uvm environment
本篇主要介绍uvm_env
uvm environment实际上是验证环境的可重用的单元。 其中可以包含多个uvm_agent, 不同的interface，
coverage collector和checker等。
如下图所示是一个uvm_env的示例图：
下面说明创建uvm_env的过程：
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uvm testbench顶层和testcase的编写
本篇主要介绍UVM testbench top和test case如何来写。
test toptestbench 的顶层应该是整个UVM结构的根， 如下图所示， 顶层中可以包含几个test case， test case的下层是XXX_env, env下面又分成几个部门，比如多个uvm_com
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UVM中的phase
虽然是做ASIC design的，但似乎有点必要学习一下UVM。 就逐步记录一下UVM中的一些重要的内容和学习笔记。 本篇就记录一下UVM phase的理解。
UVM phase简介UVM的phase实际上提供了仿真过程的一种同步机制。可以大体上分成三种：
Build time phases
Ru
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viterbi解码算法简介
发表于
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通信
这篇文章就简单复习一下卷积码和Viterbi解码算法。
编码结构线性分组码码的每个分组是独立的， 并没有相关性。卷积码却不同， 类似卷积运算， 每个分组相互影响， qi结构如下所示：
常用[n,k,L]来简单表示卷积码：其中n代表的是输出bit， k代表的是输入bit， L代表的是约束长度。在上面
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基于sum_product LDPC 解码算法
发表于
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通信
Tanner 图LDPC码的校验矩阵可以用tanner graph来表示，如下图所示：
图中的左侧是信息节点（message nodes），代表的一个码字中的bit个数，右侧则是校验节点。
sum-product解码算法sum-product解码算法的目的是计算最大的后验概率（maximum a
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