uvm_config_db应用示例
本篇举2个例子说明一下uvm中config_db的使用：如下图所示
case 1
我们把第一个参数设置为null， 并且instance_name设置为uvm_test_top, 这就意味着test_case中所有的component都可以访问要设置的item：
12345678910111
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uvm 中的config_db介绍
UVM环境中的config_db实际上是一个数据库，我们可以设置一些参数， 然后在不同的地方获取这个参数。比如可以在顶层的testcase中设置一个cov_en变量用于控制覆盖率的收集， 这样就不用每次修改testbench。
set()
1234static function void set
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uvm中的factory重载机制
在uvm 中可以利用factory机制的重载作用改变某些component的特性， 而不用去修改testbench。比如说：
你写了2个driver的class， 但是uvm环境中只需要用到一个，如果这两个driver都是用factory注册，那么就可以用override的方式替换当前uvm环境中的
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verdi波形颜色的配置
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EDA
常常要写文档时候需要Verdi的波形， 但是默认情况下是黑色背景， 不是很美观，比如下图：
可以改变成白色背景， 黑色字体和波形， 这样就和文档的背景色， 前景色匹配了。
先改变背景色
背景色的配置主要在下面的选项框中：
选中Waveform Pane Background这个选项，配置成
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matlab绘图示例
今天本想用matlab处理一下数据画个图， 但是却不怎么记得起一些常用的plot参数。 本篇就举一个matlab绘图的例子， 备忘。
123456789101112131415161718192021222324%% Plot BER @ iteration = 0rng('default');lo
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uvm sequencer和driver通信
uvm driver从sequencer FIFO中获取request类型的sequence item（REQ）， 类似握手协议， 返回一个response类型的（RSP）。如下图所示：
本篇主要介绍在driver中使用get_next_item的方法。
这种情况下， driver获取seque
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uvm_virtual_sequence
virtual sequence实际上是一个容器， 其中包含多个sequence， 这些sequence可以给不同env的sequencer发送激励。 比如Soc系统中有PCIe， wishbone， apb总线，一个比较好的方式就是使用virtual sequence进行控制：
如下图所示：
v
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uvm_scoreboard
本篇主要介绍一下uvm_scoreboard的作用和创建步骤。
uvm_scoreboard一般是包含了refrence model和checker， 用refrece model的输出和电路的输出做对比， 来判断电路是否工作正常。
一个典型的应用如下图所示。 对于一些信号处理算法相关的电路，
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uvm中的agent
在实际的验证环境中， uvm_agent应该算是比较大的uvm_componet， 里面可以包含squencer、driver、monitor等单元。如下图所示：
同样uvm agent也可以进行一些参数的配置
agent可以分成两种：
active
包含所有的component， 比如se
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