通信中的符号同步
本篇主要学习一下符号同步相关的技术， 特别是timing 同步的环路， 这里的环路指的并不是PLL。
Timing 环路的构成时间同步环路常由TED， 环路滤波器， VCO构成， 如下下图所示[1]:
对于离散时间系统来说， 第n个接收到的符号可以用下面的模型来表示：
y(nT_s) = \sum
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毫米波雷达学习（一）
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通信
mmWave雷达传输波长在毫米范围内的信号。 那么mmWave信号所需的天线很小。 短波长另外的一个优点是高精度。 mmWave系统工作在76-81 GHz（带有相应的波长约4毫米），将具有检测运动的能力小到几分之一毫米。
本系列就主要来学习一下关于毫米波雷达的一些基础知识和信号处理算法。
基础概念
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FPGA验证有用的脚本
在芯片RTL设计完成后， UVM仿真验证和FPGA原型验证可以同时展开。
本篇记录一下FPGA prototype 常用的脚本。
synplify 综合
使用synplify综合的时候， 工具不能读入filelist， 所以需要将filelist转成一个*.v 文件。
12345678910111
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systemverilog 中的constraint
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IC验证
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SystemVerilog
本篇主要介绍一些 systemverilog 中的constraint。
1. 简单表达式我们可以用> < >= <=等符号来对变量进行简单的约束， 注意的是当要把某个变量设为定值时， 需要使用==符号。
比如下面的例子：
123456789101112131415161
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RTL coding中的TAB问题
在RTL coding的时候应该尽量避免TAB的使用。
TAB 的显示
在 GVim中可以使用命令：
basic1:set list
来显示文件中的TAB字符， 如下图所示， tab字符被显示成 ‘ ^I ‘
如果使用下面命令
1:set listchars=tab:>-,trail:
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python获取命令行参数
sys.argvpython中可以用sys.argv获取命令行参数
sys.argv 是命令行参数列表
len(sys.argv)是命令行参数的个数
sys.argv[0] 是当前执行的脚本名称
比如下面的代码：
12345678910#!/usr/bin/pythonimport sysp
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python学习之一
ASIC 设计中经常处理一些文本， 常用的脚本语言Perl， python都可以胜任， 但是我更偏向于python， 语法简单易懂， 没有perl那么多奇奇怪怪的符号。
本篇就来记录一些常用的python基础知识加以备忘。
python字符的大小写转换
12345str = "www.runoo
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systemverilog assertion 介绍
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IC验证
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SystemVerilog
在RTL设计或者是使用Formal Verification的工具时， 常用assertion来描述设计意图。本篇就主要介绍一下systemverilog的assertion。
Immediate Assertions
常常用于仿真， 当某个条件满足的时候打印一些debug信息， 相当于if语句
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